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QorIQ T1040 DIFF_SYSCLK internal termination

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System clock of T1024 with and without external differential termination

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How to enable irq distribute all CPU cores

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IFC GPCM with TA

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How to disable MMU in e5500 core?

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T1040 Clock Query

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DEBUG OF T1042

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Use of TLB

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fsl,qman-frame-queues-rx

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CLK for DDR4

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T4240RDB SDK 2.0 Kernel crashes

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USDPAA Linux SDK 1.6

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Filter FOR GVDD

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question about "JTAG configuration file to override RCW"

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FMAN µCode for T2081

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DDR4 Compatibility with T1042

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t4240QDS help

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PHY-API in Linux environment T1040 fsl-sdk-v2.0

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T4240RDB: Target hangs while scanning I2C bus 0; requires hard reboot

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IBIS (DDR4) and IBIS-AMI Model for T1042

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T1042 Uboot config for x32 DDR4

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t2081 DMA transfer failed with 256 bytes or more through PCIe

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T1042 Serdes

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T1024 Single Clock Mode and JTAG

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Can we use two x16 DDR3L SDRAM

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PBL stops loading before End Command

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IFC of T1040

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Ethernet 100Mb half duplex support

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use U-boot from SD

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T1040 DDR3 PCB Routing

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I am developing on a T1024RDB development board. I was interested in purchasing a CodeWarrior TAP (CWH-CTP_BASE_HE) with the probe tip (CWH-CTP_COP_YE). I just wanted to make sure that this probe does work with the T1024RDB board? The NXP site does not

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I'm working with vxworks to bring it up on t1042D4RDB board I saw on SDK 1.9 that i need for (T1042 rev 1.1) -fsl_fman_ucode_t1040_r1.1_106_4_15.bin

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T1024 LBC Mapping Issue

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T1040 DD3L per lane write leveling

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T1040 Serdes to Phy

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QorIQ T1040 DIFF_SYSCLK input specifications

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How to recover T1042D4RDB after flash rootfs corruption

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T4240RDB - on startup ethernet failed with error -22

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Using QorIQ SDK 2.0 to build non-Linux executables

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L2 cache coherence issue on e6500 Rev-2.0

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Does the CodeWarrior TAP (CWH-CTP_BASE_HE) with the Probe tip (CWH-CTP_COP_YE) work with the T1024RDB dev board. The probe tip supported processor list does not list the T1024 processor. I want ot make certain before I buy it. Thank you

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T2080 Serdes Assignment

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T2080 Core Frequency Range

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T2080 chip errata (T2080CE)

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Facing lot of errors whiling compiling the BSP in "Suse Tumbleweed"

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QorIQ T1040 Low Power Modes

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How to create packet and send out with USDPAA

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JTAG RCW override has no effect

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QuiccEngine TDM on T1040

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T1040 rise and fall times for 3.3V

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T1040 what are the tradeoffs for selecting "single oscillator source" vs "multiple reference clock mode"

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In T2080 Processor, where need to place the RCW word in NOR FLash ?

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sdk2.0 fsl-toolchain building in fedora

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Doorbell IRQ

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T1040RDB vs T1040QDS

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T2080 Serdes lane disable

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Is there documentation on the E5500/T1042 boot process?

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T1024RDB NOR secure boot failure

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how to calculate gpio number in QORIQ Processor T1042

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T1024RDB booting from SD card

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I want to use t1042RDB therefor i tried to activate SDK version 1.9 virtual machine.

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Reload DTB file for T4240QDS

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T1040 VDD (VCORE), VDDC (VCORE_SLP)

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How to stop control at U-boot when bootdelay is zero on T1024RDB?

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vxworks7 64bit memac after send 1570MB data the network is send fail，cannot recovered！

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T1024 MDIO interface

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T2080QDS not booting U-Boot

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T1040 DDR3 ECC Strategy

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How does T1040RDB revision A compare to revision B?

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T1040RDB L2 Switch port ping fails

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Support_T4240V2_FSL_DPA ERROR

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Controlling offset into peripheral memory on T1024

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QorIQ DPAA

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how to make pbl integrated uboot image which used to boot from nand flash

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compiled kernel image: cannot execute binary file

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T1024 connect phase issues

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Where is the driver for t2080-cpld

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T2081 SD boot with Smart VT interface

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BOOT_LOC difference between T2080RDB and T2080QDS

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Linux hangs on PCIe outbound transaction

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Is secure boot possible only via NOR boot in T1024 processor?

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How to disable cache coherence on e6500?

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T2080 vs P2020 performance

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T1040RDB: Layer 2 Switch initialization

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T4240RDB new kernel

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EndPoint MSI interrupt generation on T4240

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T1042 Power Design

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u-boot nand flash boot debug on t2080

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METHOD TO SEE IPFORWARDING_APP BINARY IN T2080RDB-PC

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Booting from NOR Flash

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10G Ports in T1040RDB are not working

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tools-profile on T4240RDB

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Use of Crypto in kernel causes crash

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T2080RDB-PC Development Kit Not Booting

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The difference Between PPC64E5500 and PPCE5500 in SDK Download

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Running user space application on T1040RDB

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T4240: Altivec: is the altivec module of T4240 the same as MPC8640D?

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How many SODIMM/DIMM sockets is the T2080 DDR3/3L Memory controller designed to support?

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Where do I access inbound MSI interrupts to the T1040 processor?

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ASF and WAN VLANs

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T2081 SerDes1_PLLx not locking

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SRA app (SRIO demo) only works when initiating from one side

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T4240：CCSBAR： change CCSBAR from 0xfe000000 to 0xf3000000, only one core can startup

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T4240： boot: For the different FLASH BASE address, botorom can not start up

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T2080 DDR3 data rate to DDRCLK ratio

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T2080 VID question

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T2080 DDR3 problem

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T2080 IFC_NDDDR_CLK not documented

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fit rate

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QCVS DDR Tool Target connection setup

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L2 Switch configuration in T1040

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T4240: SRIO: Why only can see one SRIO controller by CW?

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How to configure T4240 rev. 2.0 processor to 10GBASE-KR interface instead of XFI?

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L2 Switch configuration in T1040

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Dmesg ouput of T4240RDB

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T1024 RCW when booting from SPI

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Regarding fsl sdk v2.0 on t2080qds with hypervisor

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Is T4240QDS SRIO Internal Loopback Possible?

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MACLESS Interface to USDPAA Buffer Transfer

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Question about migrating from the T1024 to other processors in the series.

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kernel and U-boot config when change DDR3 in T1042

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T2081: JTAG Boundary Scan Test

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Does the T1014 L1 and L2 cache have ECC?

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T4240_DMA3_CHANNEL_BUSY

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Wrong image format for bootm command kernel image

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T1024 and T4240 are foot print compatible or not

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Is there a way to boot secondary cores from DDR on T2080?

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T4240: AltiVec: Where can get the AltiVec Lib for vxWorks?

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T1024 IFC issue

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T4240: CPU ID: Is there any way to mark the CPU if there are more than one T4240 on the board?

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T1040RDB upstream kernel ethernet issue

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T4240QDS SATA SSD detection error

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T2080 Virtualization Support

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T2080RDB MAC Addy's

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How to build only RCW+PBL image in Yocto

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T4240: rapidio: What is the relationship between the following concepts: SRIOn, portn and rapidIO controller in the T4240RM.pdf?

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Does T2080 + sdk1.8 or 2.0 support multiples MSI?

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Hi, we are using QorIQ T4240 processor, we used 2 pcs SPI flash to store rcw and uboot file, T4240 read rcw configurations and boot from SPI device. we design two spi flash, one is active device, another is backup device, when active device image was bad,

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T4240: SRIO: why can not read "Device identity capability register" of SRIO2(offset: 0xc1000)?

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T1042 Device Tree Fman RGMII-ID

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What is included with the T1040D4RDB-PA Reference Design Board?

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T4240: rapidio: does it need to manage cache manually when use rapidIo?

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T4240: rapidio: what does " snoop local processor" in the RapidIO inbound window attributes register?

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how to add more chip selects in T1040RDB_init_core.tcl file

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Hardware Design Considerations for T1040

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T1040RDB T1040D4RDB disambiguation

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T2081 DDR3L on-board initialisation

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booting vxworks using uboot

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Classifier_Demo on the T4240 using SDK1.9

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About u-boot CONFIG_U_QE and CONFIG_QE config options

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DPAA1 Sample Code for Interfacing the Linux Network Stack with a DPAA Port.

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change T1042 DDR3

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T1040 Voltage Ramp

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T4240 Full Boot Sequence

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T1022 Example Secureboot RCW

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Support for DPAA1

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Can T1024 be configured for PCIe 1.0 x4 ?

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QCVS Serdes tool: T4240: How to set the serdes parameters?

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QCVS Serdes tool: T4240: What is the meaning of Digital Loopback, External Loopback, external?

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T4240： connect with BCM5396： The CPU side should be configured as serdes or sgmii?

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QCVS: serdes tool: where can I find the spec " SerDes Configuration and Validation Tool Companion Application Note (AN5119)"?

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trouble program T2080 IFC NAND FLASH(MT29F4G08) in vxWorks

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Unable to read write to CPLD in kernel space : T1040RDB

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