Pシリーズ

ディスカッション

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What is the ASLEEP mode in P2040 and how to over come if the target permanently went into sleep mode?

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how to modify library version in rootfs filesystem

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i am unable to write and read registers from slve Device(Accelometer LIS331DLH)perticular location ?

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Which COP J-TAG tool is most preferred to P2040 and Why? (Code Warrior TAP or Code Warrior USB TAP)

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P2041 DDR RCW MEM_PLL_RAT incorrect

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How to configure external interrupt IRQ2 in P2040

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Problem PCI RC Read_Configuration_Ready_Register from EP

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the current of AVDD

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Bringup P2041 hardware issues:

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PCI Express Read Burst Transaction

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How do I get fw_printenv and fw_setenv included in my rootfs?

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POR boot

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Polarity of PCI Express INTx/IRQn sharing

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rule to set LALE timing?

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P2020 64B network packet forwarding speed is much？

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Which Interrupt Vector for Hypervisor Privelege Interrupt?

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How to detect network cable plug/unplug on p1010 board with QorIQ SDK1.9

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Problem in configurating eTSEC2 to RGMII mode

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p1010 ttyS1 input/output error

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RS485 support in P2040

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bitbake -c compile -f u-boot failed

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QorIQ P4080 ELBC - how to configure GPCM /OR/BR/CS/LAW under UBOOT

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need Candence of Altium

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P1010 reset by software

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u-Boot and standalone applications

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cannot erase 256MB NOR flash beyond first 139MB

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When are you going to release a new QorIQ SDK (for powerpc)?

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The mechanics of switching between user/supervisor/hypervisor mode

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Regarding etsec controller of P1022

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P2040: strange behavior of network interface under linux

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Aurora Connector P2041

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P2040 SRIO outbound组播

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how can I get ltib of P2020?

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spi protocol sequence in P2040

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QORIQ P2041 ID mismatch

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PCIe machine check - "Access to an illegal configuration space"

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Cache L1 address retrieving and flush

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Adjust the DDR refresh interval

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PCIe Inbound Window Configuration on P1011

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QorIQ P1010 DMA ADDR_NO_INC

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P2020 serial port can't print after TLB init

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QCVS TOOL

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What all drivers need to be enabled in P2041 where altera fpga connected on SPI bus

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P2040:How to access TBI-SGMII registers in linux?

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How can I get a sample project for QorIQ ?

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P2040: eSPI configuration

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Auto CPO for DDR2

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[e500v2 / e500mc] R^X memory pages support?

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Using kernel v4.1 for P1022DS based board

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Enable NTPD in p2041rdb

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PCIe errors causes CPU to crash

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TLB1 IPROT bit with a PCIe IO memory space?

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P3041 error when poweron

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p1010 localbus dead

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P1020 Boot

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p.1205 of mpc8640rm.pdf describe the LTSSM of PCIE.What the detail of LTSSM,for example detect active(0) and detect active(1)?

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QCVS-DDRV passed but Linux kernel crash ?

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Programming the Flash gives Sector Protection Error

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The P1020-PD Version EVK SCH files of Candance format

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how to create a SMP bareboard project for P2020

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Time Base registers TBL & TBU

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the local address map

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Latest Linux SDK that supports the P1020

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SPI TXCNT and RXCNT

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FMAN_v2 L4 checksum computation when IPF is enabled

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consumption P2020 core 1 disabled and CHKSTP_IN1 forced to low

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can not read CCSRBAR space on custom P2020 board

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Connecting P2020 to P2020 over eTSEC

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P2041 JTAG connection error

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P2041 power issue

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c293 custom board u-boot can not show up

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P3014 - Generic Machine Check Exception Handler

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How to use GPIO-LEDS in another driver without sys interface?

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reboot fails from kernel in P1022 based target

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How to initially program a P1020 that normally boots from MMC

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XPedite5501 P2020e. Active ethernet issue (u boot)

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P2020 Processor usb not detcted

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T2080 SPI /dev/spi is not creating.

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QorIQ processor in new project.

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P2040: mac to mac connection

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NAND

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PCIE INTx issue

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p2041 srio type11 send issue

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How to use the rmu application (from usdpaa-apps) on the P4080?

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P4080 FPU performance

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qcvs ddr config screen : field <skew clk to dqs>

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Inconsistency between AN4259 and P1020RM regarding GPIO8, GPIO9

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PCI Express Controller Internal CSRs

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C293 custom board ready signal stay low issue

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P5020 LTSSM states

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Power Down Cycle

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P4040_CONSOLE_ttyS2

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Hello, now we have a project that needs your P1010 processor. Can you connect the Optical module directly to this processor? If so, which interface should I connect to?.

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P5020 PCIe lane reversal

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Timing in eLBC for P1015

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Mode configuration in eLBC for P1015

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eLBC support in U-boot

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Discrepancy about GPIO1[5] & GPIO1[15] of P1022

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Advertised e5500 dhrystone MIPs/MHz

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P2041RDB-PB - how to send a created packet out in USDPAA

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Booting issue in P1022 based target :: core0 in wait mode and core1 in run mode

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P2020 Local bus pll enable

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How to compile u-boot for p1020rdb-pd

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SGMII 10/100 on P2020

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Adding a file/folder in rootfs nxp yocto build

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bitbake fsl-image-full build error for p4080ds board

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Memory Mapping in P1015

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Ping happening in uboot but not in kernel

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Demo Board file of P2020

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Using SEC 4.4 on P1010 from bootloader

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UPM run commands where a UPM is used by multiple chip selects

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Received Packets Not Transferred from FMan Memory to DDR RAM

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NOR image execute

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p1020 with ar8033 phy dts

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Do the RGMII reference clock inputs, EC1_GTX_CLK125 and EC2_GTX_CLK125, on the P2040 have to running at boot time or can they be enabled after boot?

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RMII Configuration Support for QorIQ P1024RDB

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Error with PCI in P2041 Kernel Boot log

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Internal Boot ROM configuration on P1015

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PCI Express on my board when setting to read with DMA cause MC

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“Is it necessary that the nodes shown in "lspci" output, have to be defined in device tree ?

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Booting U-boot from SD

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IRQ conflict in P2041

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How many devices can be handled by PCI express controller of p2041

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Flashing uboot onto P1024 without JTAG

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NOR Flash issue, After root login it is throwing jffs2 issue

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Meaning of Parameters in DTS File

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reboot unsuccessfully when too many packets sent to P4080DS

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NAND flash able to write and read but booting is not happen

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P1010 hardware schematic diagram

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DDR3 Memory Interface Configuration for U-boot

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USB VBUS

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cant reboot successfully when When some packets sent to P4080ds

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How to connet these pins SENSEVDD, SENSEVSS and SENSEVDDC of P1013, whether it can be float?

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Request_irq Flag mismatch

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CS3 not asserted in P1022 based proto system

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P3041 with 4 GB DDR3 - Cannot access second rank of dual-rank mirrored memory

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How to find the CPC SRAM device driver within QorIQ SDK 2.0?

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P3041 - Power Hold Up checks

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u-boot is getting stuck at infinite_debug_loop: in start.S

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PCB Package of P2020

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eLBC P5040

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SDK for P1022DS fsl-image-full misses some important linux folders

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Why are BMan hardware buffers disappearing under high load on 10G with fragmentation enabled?

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NOR issue after kernel booted up

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Connecting 32-bit supported devices on T1022 local bus

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What is the MTBF of the P5040 microprocessor?

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Conflict on p1021 Elbc sharing with QUICC Engine pins

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What is the web link to p4080 Errata list ??

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GbE Phy not accessible through Process(P1022) MIIM

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IBIS model P5040

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Is the SEC Engine required to use Secure Boot in P2041?

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P5040 PCIe

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QorIQ P1013 DDR3 controller in 32 bits mode

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RCW and DDR3 Configuration For 4240 QorIQ

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P2020 PHY control problem

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Using TRNG output as entropy source

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P5020 Multibit ECC

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ifconfig: SIOCGIFFLAGS: No such device

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Is there a way to program a PowerPC (T4240, P4080) without a lincense for Codewarrior?

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sgmii configuration in p1022

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P2020RDB-PCA basic questions

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what' wrong with tftp

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can I boot from memory bank 1?

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booting p1022 from emmc-sd card

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Basic questions about P1022

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Generating SD Card Image for P2020 / T1042

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Enabling of exceptions

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what are the address ranges(SA--EA(end address)) DDR_SDRAM chips

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P1022 boot with 32 bit address space at the LB

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Can't get past SDC challenge/response using Codewarrior?

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problem to initialize ddr3 connection to P1022

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uboot access mac register

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P4080DS Ethernet

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SATA initialization

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phy reset time out ,no ethernet link

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boot p1013 from spi flash

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I try to connect to eval board P1022 with code warrior

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Requirement of Serdes Reference Clock in P5040 Processor

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qemu_fslgit.bb do_install failed Error!

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P2020 1.33Ghz problem

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Seeking BSDL file for QorIQ P5020

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Regarding P2020 DDR3 write leveling

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Save/Restore the necessary registers for an ISR

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system stack

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Add gcc, g++ to custom minimal image

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P2020 Target Board is not Booting with SD Card

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about booting linux

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In section 13.4.2.3.4 of QorIQ P2040 Reference Manual Rev 4, it specifies that local bus signal LOE_B asserts and negates on the rising edge of the bus clock, but in the read figures (e.g. Figure 13-14 or 13-15) the signal appears to transition on the fal

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SRIO for P2040 processor

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How to compile linux kernel for P4080 with no SMP (just one cpu)

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Memory read/write utility for P5040DS-PB

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[P2020] DUART and FIFO

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can we add exception on QE0 pin in p1025?

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"Duplicate inclusion" messages whenever I run bitbake

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[P2020] Difference between DUART_UIIRn and DUART_ULSR

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P4080: Precise Cache size including tag+status etc.

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Memory Access of secondary core in U-Boot

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TBI PHY reg read of DTSEC2, DTSEC3 always returns 0xffff

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Can the P4080DS boot from SD Card?

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Overcome the Challenges in Porting U-Boot and Linux® OS to QorIQ P5 Family Development Systems

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QE TDM Working with QUICC Multi-channel Controller

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Using QMAN Dedicated and Pool Channels in USDPAA and Linux Kernel

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Shared-MAC and MAC-less Implementation in DPAA Linux Kernel Driver

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Deploying SDK 1.3.2

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