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i.MX95 OEIおよびDDR PHYファームウェアへのカスタムLPDDR5タイミングの統合に関する説明

NXPチームの皆様、こんにちは。

i.MX9596プロセッサをベースにしたカスタムボードを、i.MX OEIブートローダーを使ってLPDDR5メモリを導入します。

MCUXpresso Config Toolsバージョン26.3を使用して、自作ボード用のDDR構成を生成しました。生成されたファイルは以下のとおりです。

• lpddr5_timing.c

• lpddr5_config.ds

• ペリフェラル.c

• ペリフェラル.h

• pin_mux.c

• pin_mux.h

OEIソースのboards/mx95lp5/ddrディレクトリ内に、以下のファイルが見つかりました。

• MIMX95_LPDDR5_EVK_19X19_6400MTS_FW2024.09_timing.c

• MIMX95_LPDDR5_EVK_19X19_6400MTS_FW2024.09_ECC_enabled_timing.c

• XIMX95LPD5EVK19_6400mbps_train_timing_a1.c

カスタムLPDDR5ボードの正しい統合手順を確認したいのですが。

1. 生成されたlpddr5_timing.cMIMX95_LPDDR5_EVK_19X19_6400MTS_FW2024.09_timing.c の代わりにこれを使用し、OEI_DDR_CONFIG を更新して新しいタイミングファイルを参照するようにしますか？

2. XIMX95LPD5EVK19_6400mbps_train_timing_a1.cはNXPが提供するシリコン専用のトレーニングファイルで、カスタムボードでは変更されないべきでしょうか?

3. OEIは以下のDDR PHYファームウェアバイナリを使用します。

• lpddr5_imem_v202409.bin

• lpddr5_dmem_v202409.bin

• lpddr5_imem_qb_v202409.bin

• lpddr5_dmem_qb_v202409.bin

これらの同じファームウェアバイナリは、生成されたDDRのタイミング設定とファームウェアバージョンが一致していれば、カスタムLPDDR5ボード上で再利用できますか?

1. ECC対応タイミングファイルは、LPDDR5 ECCが有効になっている場合にのみ必要ですか？カスタムボードでECCを使用しない場合、通常のタイミングファイルで十分でしょうか？

EVK DDR構成からカスタムLPDDR5ボードに移行する際に、再生成または変更が必要な追加ファイルがあればお知らせください。

よろしくお願いします。

Re: Clarification on Integrating Custom LPDDR5 Timing into i.MX95 OEI and DDR PHY Firmware Usage

こんにちは、

1. はい、MIMX95_LPDDR5_EVK_19X19_6400MTS_FW2024.09_timing.c をカスタム構成に置き換える必要があります。

2. それはそのシリコンリビジョンごとに異なる構成なので、あなたのCASEであれば参考にCAN。この構成を使っていない場合は、そのままにしておいても構いません。

3. はい、これらのバイナリは類似の構成に再利用でき、通常のタイミングファイルで十分で、ECCを使わない場合は十分です。

よろしくお願いいたします。