im6xullGPIO在开漏情况下如何输出高阻

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im6xullGPIO在开漏情况下如何输出高阻

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Contributor I

引脚外接p沟道mos的栅极,p沟道源极接5V,之间用上拉电阻连接

微信图片_20200110155712.png

配置图ODE设置开漏,pull_en_b使能,pu/pd/keeper必须三选1

如何配置gpio,只需要开漏输出不需要pu/pd?

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NXP TechSupport
NXP TechSupport

Hi bloath,

   I.MX的每个引脚都可以配置上拉、下拉和Open Drain,每个脚都有一个driver的配置寄存器,以GPIO3_IO18为例:

寄存器:IOMUXC_SW_PAD_CTL_PAD_GPIO3_IO18

Address: 20E_0000h base + 3D8h offset = 20E_03D8h

pastedImage_1.png

pastedImage_2.png

这个bit[11]配置1,GPIO3_18引脚,就是OD了。

这些信息,你可以在reference manual中得到。

Have a nice day!

BR,

weidong

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